LS1012Aリファレンスマニュアル(LS1012ARM Rev. 3 LS1012ARM.pdf)の記述は、
出来る限りJEDEC規格の記載と一致させようとしています。
JEDEC規格では、tANPDはclock単位で定義されており、これは入力クロックのクロックエッジ数です。
tODTLonはnsec(ナノ秒)単位で定義されています。これは
LS1012Aリファレンスマニュアルではクロックの[cycles]で表しており、クロックは「tMCK(MCK[n] cycle time)」を意味します。
LS1012Aでは対応するDDR3Lメモリの動作周波数は1,000MT/sのため、この1cycleは 2nsec です。