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【TI︓プロセッサ】 AM62X HW：外部メモリ用電源に関して
AM623 / AM625に接続されるDDR PHY および SDRAM 電源の設計に関して
考慮すべき情報を教えてください。
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回答
DDR PHY および SDRAM 電源の設計
・AM625 / AM623 / AM625-Q1 / AM620-Q1
選択したメモリに応じて、DDR PHY IO (VDDS_DDR) および DDR クロック IO
選択したメモリに応じて、DDR PHY IO (VDDS_DDR) および DDR クロック IO
(VDDS_DDR_C) の電源レールは 1.1 V (LPDDR4) または 1.2 V (DDR4) になります。
詳細については、デバイス固有のデータシートの「Specifications」の章の
詳細については、デバイス固有のデータシートの「Specifications」の章の
「Recommended Operating Conditions」セクションを参照してください。
・AM625SIP
VDDS_MEM_1P1 (LPDDR4 SDRAM IO 電源 (LPDDR4 SDRAM VDD2 および
VDDS_MEM_1P1 (LPDDR4 SDRAM IO 電源 (LPDDR4 SDRAM VDD2 および
VDDQ 電源レールを供給)) は、VDDS_DDR (DDR PHY IO 電源) と同じ電源から電力を
供給することを推奨します。
VDDS_MEM_1P1 および VDDS_DDR 電源レールは 1.1 V (LPDDR4) に接続されています。
VDDS_MEM_1P8 (LPDDR4 SDRAM コア電源 (LPDDR4 SDRAM VDD1 電源レールを供給))
VDDS_MEM_1P1 および VDDS_DDR 電源レールは 1.1 V (LPDDR4) に接続されています。
VDDS_MEM_1P8 (LPDDR4 SDRAM コア電源 (LPDDR4 SDRAM VDD1 電源レールを供給))
は 1.8 V です。
詳細については、デバイス固有のデータシート (AM625SIP – 統合 LPDDR4 SDRAM を備えた
詳細については、デバイス固有のデータシート (AM625SIP – 統合 LPDDR4 SDRAM を備えた
AM6254 Sitara™ プロセッサ) の「Specifications」の章にある「Recommended Operating
Conditions」セクションを参照してください。
尚、本FAQは下記ドキュメントの内容を参考に作成しています。
3.2.3 DDR PHY and SDRAM Power Supply