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『 Lattice Semiconductor 』内のFAQ

66件中 1 - 10 件を表示

≪ 1 / 7ページ ≫

【Lattice：設計ツール】ModelSimのラティスのライブラリコンパイル方法を知りたい

弊社で作成したModelSim PE(10.2d) セットアップ(ライセンス設定、ライブラリコンパイル)を会員様限定で公開しています。ログイン後「設計ツール」の「【会員様限定】資料ダウンロード」ページから「【Lattice:資料ダウンロード】ModelSimの設定方法を知りたい」のFAQを開き、添付ファイ... 詳細表示
- No：192
- 公開日時：2018/08/17 15:21
- 更新日時：2021/12/21 17:37
- カテゴリー：設計ツール , FPGA
【Lattice：設計ツール】Lattice Diamondの有償版と無償版の違い

SubscriptionとFreeの違いはターゲットデバイスのみです。高速シリアルトランシーバ(SerDes)を搭載しているデバイス(例：ECP5-UM、ECP3、ECP2/Mなど）を使用する場合は、SerDes使用の有無に関わらずSubscriptionが必要となります。 SerDesを搭... 詳細表示
- No：963
- 公開日時：2018/08/21 18:13
- 更新日時：2021/06/29 15:34
- カテゴリー：設計ツール , FPGA
【Lattice：FPGA/設計ツール】Lattice Diamondが起動できない

ほとんどの場合はライセンスファイルの設定ミスかライセンス期限切れが原因ですので、 (1) 環境変数のLM_LICENSE_FILEの値がライセンスファイルのあるパスに正しく設定されているか　 (添付ファイル"Diamond_Reature&Expierd.png”をご参照ください) ... 詳細表示
- No：961
- 公開日時：2018/08/22 17:58
- 更新日時：2021/06/29 15:28
- カテゴリー：設計ツール , FPGA
【Lattice：設計ツール】開発ツールライセンスの期限について

ラティスセミコンダクターの開発ツールには1年間のライセンス期限があります。ライセンスが切れた場合、ispLEVER ClassicおよびLattice Diamondの有償版(Subscription)をご使用の場合は新たにご購入いただき、入手されたSerial No.で再度ライセンスを申請してく... 詳細表示
- No：969
- 公開日時：2018/08/22 17:42
- 更新日時：2021/06/29 15:39
- カテゴリー：設計ツール , CPLD , FPGA , 電源管理IC
【Lattice：FPGA】デバイスの未使用ピンの処理方法

ラティスセミコンダクターのFPGAおよびCPLDでは、未使用ピンには自動で内部プルダウン処理されるため、外部処理は必要ありません。下記、ラティスセミコンダクターのアンサーデータベースもご参照ください。 Do the unused I/O pins need to be groun... 詳細表示
- No：940
- 公開日時：2018/08/22 17:43
- 更新日時：2021/06/29 15:20
- カテゴリー： FPGA
【Lattice：設計ツール】 Lattice Diamond 情報のまとめ

・Lattice Diamondの入手と使用方法　　Diamond の最新版は Lattice社ホームページより入手をお願い致します。　　インストールガイド、ユーザーガイドなど各種資料についても　　同ページから閲覧、ダウンロードすることが可能となっております。　　　Lattice ... 詳細表示
- No：9029
- 公開日時：2021/07/12 17:02
- 更新日時：2021/12/03 15:42
- カテゴリー：設計ツール
【Lattice：設計ツール】Synplify Proのエラーおよびワーニングメッセージの調べ方を知りたい

お手数ですが、Synplify Proを単体起動して再度論理合成を実行してください。ログのエラーやワーニングの番号をクリックするとヘルプが開き、意味を調べることができます。詳細表示
- No：958
- 公開日時：2018/08/22 17:43
- 更新日時：2021/06/29 15:31
- カテゴリー：設計ツール , FPGA
【Lattice：FPGA】MachXO2とMachXO3L/3LFの違いは

MachXO2、MachXO3L、MachXO3LFの主な違いは以下の通りです。回路情報の保存主な相違点 MachXO2 FLASH：10万回書き換え可能 SRAM：書き換え無制限 (SRAMアクセスはJTAG経由のみ) ・幅広いパッケ... 詳細表示
- No：814
- 公開日時：2018/08/17 17:09
- 更新日時：2018/12/11 09:54
- カテゴリー： FPGA
【Lattice：設計ツール】ModelSimとActive-HDLの違いを知りたい。

ModelSim LE(Lattice Edition)とActive-HDL LE(Lattice Edition)の違いは以下の表の通りです。 ModelSim LE (※) Active-HDL LE 性能比較 Active-HDL LEの約7倍 (... 詳細表示
- No：7660
- 公開日時：2021/06/18 17:29
- 更新日時：2021/06/29 16:21
- カテゴリー：設計ツール , CPLD , FPGA
【Lattice：設計ツール】RTLシミュレーションで期待した結果が得られません。

テストベンチファイルにGSR（Global Set/Reset）及びPUR（Power Up Set/Reset）はインスタンスされていますか。【Verilog記述例】 GSR GSR_INST( .GSR() ); PUR PUR_INST( .PUR() ); 詳細表示
- No：1758
- 公開日時：2018/09/14 14:44
- 更新日時：2021/06/29 15:58
- カテゴリー：設計ツール , FPGA

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