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『インターフェイス』内のFAQ

33件中 1 - 10 件を表示

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【TI：インターフェイス】 RS-485　外付けフェイルセーフ回路の抵抗値の計算方法

3つの条件下でそれぞれ求められた式から各抵抗値を算出することが出来ます。 a) 伝送路が短絡状態になった場合上図より、R2が回路から除去され、レシーバの両入力間の電圧が次式で表すことが出来ます。　　　　　　 RS-485の... 詳細表示
- No：5673
- 公開日時：2020/06/30 19:50
- 更新日時：2020/09/29 17:07
- カテゴリー：インターフェイス
【TI：インターフェイス】 RS-485　フェイルセーフとは

複数のドライバ/レシーバからなるインターフェイスシステムでは、 ICがアクティブでない期間が長く、通信回線が通常とは異なる状態になる事があります。その為、ノイズの影響を受けたり信号ラインの電圧がフローティング状態になる直前の論理によってレシーバが誤動作を起こす可能性があります。この様... 詳細表示
- No：5596
- 公開日時：2020/06/18 16:11
- 更新日時：2020/09/29 17:11
- カテゴリー：インターフェイス
【TI：ロジック】 I2Cバスロックとは

I2Cバスロックとは、I2Cスレーブがバスラインを"LOW"に固定して開放されない状態です。これは、スレーブ側デバイスの状況によって起こる現象で、いろいろな原因があります。例えば、スレーブとなるデバイス内にマイクロプロセッサがあり、何か内部処理中にI2Cコマンドを受けた場合に発... 詳細表示
- No：1115
- 公開日時：2018/08/24 09:24
- 更新日時：2019/11/12 09:26
- カテゴリー：ロジック , プロセッサ , マイコン , その他 , インターフェイス
【TI：インターフェイス】 RS-485　外付けフェイルセーフ回路の参考例

一般的な回路例をいくつか示します。各回路の目的は、レシーバ入力側の電圧を最小入力閾値よりも高い値に保つことです。また、3つの通信回路が通常とは異なる状態（オープン /アイドル / 短絡）のうち 1つ以上の状態下で既知の論理ステートを保つことです。各回路図の右の表に記載されている項目は... 詳細表示
- No：5667
- 公開日時：2020/06/29 21:31
- 更新日時：2020/09/29 16:58
- カテゴリー：インターフェイス
【TI：インターフェイス】 DP83822I 100Base-TXのコンプライアンステスト

DP83822I 100Base-TXのコンプライアンステストで設定が必要なレジスタは、以下になります。　-Basic Mode Control Register(BMCR) 0x0000 　-PHY Control Register(PHYCR) 0x0019 　-PHY Reset... 詳細表示
- No：687
- 公開日時：2018/08/16 13:50
- 更新日時：2018/12/17 10:33
- カテゴリー：インターフェイス
【TI：その他】パッケージ Tjunction（ジャンクション温度）の確認方法

ジャンクション温度(Tj)は、使用方法や環境 (PCBの素材や気温)によって一概に規定できませんが、参考値を算出されたい場合は、以下の資料とデータシートの値で算出できます。・Semiconductor and IC Package Thermal Metrics (spra953) 詳細表示
- No：2646
- 公開日時：2018/11/28 14:11
- 更新日時：2020/03/16 10:58
- カテゴリー：その他 , プロセッサ , 電源IC , データ・コンバータ , マイコン , ロジック , クロック/タイミング , センサ , RFとマイクロ波 , アンプ , オーディオ , スイッチ/マルチプレクサ , インターフェイス , モーター・ドライバ , ワイヤレス・コネクティビティ , アイソレーション
【TI：インターフェイス】 RS-485 ユニット・ロードの概念

RS-485では許容されるバスの最大数を推定する為に、単位負荷（ユニット・ロード：U.L）という概念を取り入れています。 1ユニット・ロードが持つRS-485レシーバの入力インピーダンスは12kΩ以上と定義されています。規格では、1つのRS-485バス上に1ユニット・ロードの負荷を持つレシー... 詳細表示
- No：6163
- 公開日時：2020/09/24 16:51
- 更新日時：2021/01/06 15:23
- カテゴリー：インターフェイス
【TI：インターフェイス】 DP83822 /INT PWDN端子について

この端子はオープンドレインで出力に弱い（高抵抗）内部プルアップが接続されています。従って、この端子はオープンでHighになります。通常モードで/INT端子のLowアサートを使用しない場合は、端子をオープンにしても問題ありません。パワーダウンモードにするには、PWDN端子をLowに保持する必要があり... 詳細表示
- No：2249
- 公開日時：2018/08/22 14:23
- 更新日時：2018/10/01 18:31
- カテゴリー：インターフェイス
【TI：インターフェイス】 DS90CR483Aの未使用のLVDS出力の端子処理について

データシートのUNUSED LVDS OUTPUTS項目を確認してください。 100Ω終端としてください。 UNUSED LVDS OUTPUTS Unused LVDS output channels should be terminated with 100 Ohm at the... 詳細表示
- No：3992
- 公開日時：2019/09/03 10:52
- 更新日時：2019/12/23 16:59
- カテゴリー：インターフェイス
【TI：インターフェイス】 DP83867 マグネティックの注意点

マグネティックには、PHY側の各センタータップ(CT)が内部で接続されている製品と接続されていない製品があります。 DP83867を使用する場合は、マグネティックのPHY側の各CTを個別にグランドにデカップリングすることを強く推奨しています。そのため、各CTが内部で接続されていないマグネティ... 詳細表示
- No：2077
- 公開日時：2018/08/24 16:45
- 更新日時：2018/10/01 15:17
- カテゴリー：インターフェイス

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