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『設計ツール』内のFAQ

30件中 1 - 10 件を表示

≪ 1 / 3ページ ≫

【Lattice：FPGA/設計ツール】Lattice Diamondが起動できない

ほとんどの場合はライセンスファイルの設定ミスかライセンス期限切れが原因ですので、 (1) 環境変数のLM_LICENSE_FILEの値がライセンスファイルのあるパスに正しく設定されているか　 (添付ファイル"Diamond_Reature&Expierd.png”をご参照ください) ... 詳細表示
- No：961
- 公開日時：2018/08/22 17:58
- 更新日時：2021/06/29 15:28
- カテゴリー：設計ツール , FPGA
【Lattice：設計ツール】開発ツールライセンスの期限について

ラティスセミコンダクターの開発ツールには1年間のライセンス期限があります。ライセンスが切れた場合、ispLEVER ClassicおよびLattice Diamondの有償版(Subscription)をご使用の場合は新たにご購入いただき、入手されたSerial No.で再度ライセンスを申請してく... 詳細表示
- No：969
- 公開日時：2018/08/22 17:42
- 更新日時：2021/06/29 15:39
- カテゴリー：設計ツール , CPLD , FPGA , 電源管理IC
【Lattice：設計ツール】Lattice Diamondの有償版と無償版の違い

SubscriptionとFreeの違いはターゲットデバイスのみです。高速シリアルトランシーバ(SerDes)を搭載しているデバイス(例：ECP5-UM、ECP3、ECP2/Mなど）を使用する場合は、SerDes使用の有無に関わらずSubscriptionが必要となります。 SerDesを搭... 詳細表示
- No：963
- 公開日時：2018/08/21 18:13
- 更新日時：2021/06/29 15:34
- カテゴリー：設計ツール , FPGA
【Lattice：設計ツール】ModelSimのラティスのライブラリコンパイル方法を知りたい

弊社で作成したModelSim PE(10.2d) セットアップ(ライセンス設定、ライブラリコンパイル)を公開しています。「資料ダウンロード」ページからダウンロードしてください。ファイル名：ModelSim_Setup_v1.1.pdf なお、Lattice Diamond等に付属するMod... 詳細表示
- No：192
- 公開日時：2018/08/17 15:21
- 更新日時：2021/06/29 14:59
- カテゴリー：設計ツール , FPGA
【Lattice：設計ツール】Synplify Proのエラーおよびワーニングメッセージの調べ方を知りたい

お手数ですが、Synplify Proを単体起動して再度論理合成を実行してください。ログのエラーやワーニングの番号をクリックするとヘルプが開き、意味を調べることができます。詳細表示
- No：958
- 公開日時：2018/08/22 17:43
- 更新日時：2021/06/29 15:31
- カテゴリー：設計ツール , FPGA
【Lattice：設計ツール】 Lattice Diamond 情報のまとめ

・Lattice Diamondの入手と使用方法　　Diamond の最新版は Lattice社ホームページより入手をお願い致します。　　インストールガイド、ユーザーガイドなど各種資料についても　　同ページから閲覧、ダウンロードすることが可能となっております。　　　Lattice ... 詳細表示
- No：9029
- 公開日時：2021/07/12 17:02
- 更新日時：2021/12/03 15:42
- カテゴリー：設計ツール
【Lattice：設計ツール】CPLD開発ツール(ispLEVER Classic)のインストール、使用方法を知りたい

【Lattice：資料ダウンロード】ラティスセミコンダクター資料ダウンロードのページから ispLEVER インストール手順、ispLEVER_使用ガイド、をダウンロードしてご参照ください。詳細表示
- No：4844
- 公開日時：2020/03/03 10:46
- 更新日時：2021/06/29 16:08
- カテゴリー：設計ツール , CPLD
【Lattice：設計ツール】Lattice Diamondの回路図エディタで入力・出力ポートを追加する方法

Lattice DiamondのSchematic Editorで入力および出力ポートを追加するには次の手順を行います。１．入力段および出力段のシンボル(ANDゲートやF/Fなど)のピンにワイヤを接続２．ワイヤに名前を付ける３．I/Oポートのアイコンを右クリックし方向(Input/... 詳細表示
- No：966
- 公開日時：2018/08/22 17:58
- 更新日時：2021/06/29 15:38
- カテゴリー：設計ツール , FPGA
【Lattice：設計ツール】ModelSimでシミュレーション中に 'GSR_INST'、 'PUR_INST' に関するエラーが発生するが回避策は？

Active-HDLと同様に、GSRとPURを、テストベンチTOP階層に記述してください。詳しくは下記アンサーデータベースをご参照ください。 https://www.latticesemi.com/support/answerdatabase/3/4/340 詳細表示
- No：7712
- 公開日時：2021/06/25 16:18
- 更新日時：2021/06/29 16:31
- カテゴリー：設計ツール , FPGA
【Lattice：設計ツール】ModelSimとActive-HDLの違いを知りたい。

ModelSim LE(Lattice Edition)とActive-HDL LE(Lattice Edition)の違いは以下の表の通りです。 ModelSim LE (※) Active-HDL LE 性能比較 Active-HDL LEの約7倍 (... 詳細表示
- No：7660
- 公開日時：2021/06/18 17:29
- 更新日時：2021/06/29 16:21
- カテゴリー：設計ツール , CPLD , FPGA

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