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- No：9771
- 公開日時：2022/01/26 17:57
- 更新日時：2022/05/30 17:59
- カテゴリー：当サイトについて , CPLD , FPGA , 電源管理IC , 設計ツール , その他 , その他 , Auto MCU and Processor , Analog , Power Management , RF , Wi-Fi/BT , Digital Networking , i.MX , Kinetis , LPC , NFC , 開発ツール
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- No：320
- 公開日時：2018/07/26 19:30
- 更新日時：2022/05/30 16:40
- カテゴリー：当サイトについて , プロセッサ , 電源IC , データ・コンバータ , マイコン , ロジック , その他 , クロック/タイミング , センサ , RFとマイクロ波 , アンプ , オーディオ , スイッチ/マルチプレクサ , インターフェイス , モーター・ドライバ , ワイヤレス・コネクティビティ , アイソレーション , CPLD , FPGA , 電源管理IC , 設計ツール , その他 , Sensors , Memories , USB , Clocks&Timing solutions , Wireless Connectivity , DLP , DLP Pico Display , DLP Light Control , DLP 開発サポート , MOSFET , IGBT , HEMT(GaN) , ゲートドライバーIC , モーターコントロールIC , 産業用絶縁型インターフェース , リニア電圧レギュレータ , DC-DCコンバータ , マイクロコントローラ , その他
【Lattice：設計ツール】 Lattice sensAI 情報のまとめ

・Lattice sensAI スタックとは? Lattice FPGA にAI の推論機能を実装するためのソリューションです。評価ボード、IPコア、開発ツール、リファレンスデザイン/デモ、デザインサービスといった Lattice AIソリューションの導入に必要となるすべてを提供し... 詳細表示
- No：9033
- 公開日時：2021/07/12 17:02
- 更新日時：2021/12/03 15:27
- カテゴリー：設計ツール
【Lattice：設計ツール】 Lattice Propel 情報のまとめ

・Lattice Propelとは? RISC-Vをコアとしたプロセッサシステムの構築環境です。プロセッサ、ペリフェラルのハードウェア開発環境Lattice Propel Builder、ソフトウェア開発環境 Lattice Propel SDK から構成されております。 ... 詳細表示
- No：9032
- 公開日時：2021/07/12 17:02
- 更新日時：2021/12/03 15:28
- カテゴリー：設計ツール
【Lattice：設計ツール】 ispLEVER Classic 情報のまとめ

・ispLEVER Classic の入手と使用方法 Diamond の最新版は Lattice社ホームページより入手をお願い致します。インストールガイド、ユーザーガイドなど各種資料についても同ページから閲覧、ダウンロードすることが可能となっております。 ispLEVER Cla... 詳細表示
- No：9031
- 公開日時：2021/07/12 17:02
- 更新日時：2021/12/03 15:23
- カテゴリー：設計ツール
【Lattice：設計ツール】 Lattice Diamond 情報のまとめ

・Lattice Diamondの入手と使用方法 Diamond の最新版は Lattice社ホームページより入手をお願い致します。インストールガイド、ユーザーガイドなど各種資料についても同ページから閲覧、ダウンロードすることが可能となっております。 Lattice ... 詳細表示
- No：9029
- 公開日時：2021/07/12 17:02
- 更新日時：2021/12/03 15:42
- カテゴリー：設計ツール
【Lattice：設計ツール】 Lattice Radiant 情報のまとめ

・Lattice Radiant の入手と使用方法 Radiant の最新版は Lattice社ホームページより入手をお願い致します。インストールガイド、ユーザーガイドなど各種資料についても同ページから閲覧、ダウンロードすることが可能となっております。 Lattice Rad... 詳細表示
- No：7840
- 公開日時：2021/07/12 17:02
- 更新日時：2021/12/03 15:25
- カテゴリー：設計ツール
【Lattice：設計ツール】ModelSimでシミュレーション中に 'GSR_INST'、 'PUR_INST' に関するエラーが発生するが回避策は？

Active-HDLと同様に、GSRとPURを、テストベンチTOP階層に記述してください。詳しくは下記アンサーデータベースをご参照ください。 https://www.latticesemi.com/support/answerdatabase/3/4/340 詳細表示
- No：7712
- 公開日時：2021/06/25 16:18
- 更新日時：2021/06/29 16:31
- カテゴリー：設計ツール , FPGA
【Lattice：設計ツール】配置配線後に「VCCIOとGNDに流せる電流値は"n*8mA"まで」とのワーニングが発生するが、どうすれば良いか？

VCCIOとGNDペアの配置はラティスの各デバイスの製品ページから対象デバイスのピン配置 (Pinout)表のCSVファイルを入手して確認してください。基本的な考え方としてはVCCIOx (xはバンク番号)から次のVCCIOxの間が一つのペアとお考え下さい。この間には1本以上のGNDピンが... 詳細表示
- No：7709
- 公開日時：2021/06/25 16:10
- 更新日時：2021/06/30 18:52
- カテゴリー：設計ツール , CPLD , FPGA
【Lattice：設計ツール】Modelsimで、波形表示のフォーマットを変えたい。

Modelsimのシミュレーション波形上で、信号名を右クリック→Radix→フォーマットを選択します。 2進の他に、10進・16進他が選べます。例)/tp/sin_outを2進数から16進数に変更 /tp/sin_outを16進数に変更後詳細表示
- No：7683
- 公開日時：2021/06/18 17:09
- 更新日時：2021/06/29 16:13
- カテゴリー：設計ツール , CPLD , FPGA

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