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『設計ツール』内のFAQ

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【Lattice：FPGA/設計ツール】Lattice Diamondの起動時に”License check out failed”が発生してしまい起動できない

ほとんどの場合はライセンスファイルの設定ミスかライセンス期限切れが原因ですので、・環境変数がライセンスファイルに正しく設定されているか・ライセンスファイルを開き、期限が切れていないかをご確認いただき、いずれも問題無いようであればライセンスを再発行することで回避できる... 詳細表示
- No：961
- 公開日時：2018/08/22 17:58
- 更新日時：2018/10/01 11:56
- カテゴリー：設計ツール , FPGA
【Lattice：FPGA/設計ツール】Lattice Diamondの有償版と無償版の違い

SubscriptionとFreeの違いはターゲットデバイスのみです。高速シリアルトランシーバ(SerDes)を搭載しているデバイス(例：ECP5-UM、ECP3、ECP2/Mなど）を使用する場合は、SerDes使用の有無に関わらずSubscriptionが必要となります。 SerDesを搭... 詳細表示
- No：963
- 公開日時：2018/08/21 18:13
- 更新日時：2018/10/01 11:55
- カテゴリー：設計ツール , FPGA
【Lattice：FPGA/設計ツール】ModelSimのラティスのライブラリコンパイル方法を知りたい

弊社で作成したModelSim PE(10.2d) セットアップ(ライセンス設定、ライブラリコンパイル)を公開しています。ファイル名：ModelSim_Setup_v1.1.pdf 「資料ダウンロード」ページからダウンロードしてください。詳細表示
- No：192
- 公開日時：2018/08/17 15:21
- 更新日時：2020/03/03 10:35
- カテゴリー：設計ツール
【Lattice：FPGA/設計ツール】RTLシミュレーションで期待した結果が得られません。

テストベンチファイルにGSR（Global Set/Reset）及びPUR（Power Up Set/Reset）はインスタンスされていますか。【Verilog記述例】 GSR GSR_INST( .GSR() ); PUR PUR_INST( .PUR() ); 詳細表示
- No：1758
- 公開日時：2018/09/14 14:44
- 更新日時：2018/10/01 12:01
- カテゴリー： FPGA , 設計ツール
【Lattice：CPLD/FPGA/電源管理IC/設計ツール】開発ツールライセンスの期限

ラティスセミコンダクターの開発ツールには1年間のライセンス期限があります。ライセンスが切れた場合、Lattice Diamondの有償版(Subscription)をご使用の場合は新たにご購入いただき、入手されたSerial No.で再度ライセンスを申請してください。それ以外の無償ツールの... 詳細表示
- No：969
- 公開日時：2018/08/22 17:42
- 更新日時：2018/10/01 11:38
- カテゴリー：設計ツール , CPLD , FPGA , 電源管理IC
【Lattice：FPGA/設計ツール】Lattice Diamondの回路図エディタで入力・出力ポートを追加する方法

Lattice DiamondのSchematic Editorで入力および出力ポートを追加するには次の手順を行います。１．入力段および出力段のシンボル(ANDゲートやF/Fなど)のピンにワイヤを接続２．ワイヤに名前を付ける３．I/Oポートのアイコンを右クリックし方向(Input/... 詳細表示
- No：966
- 公開日時：2018/08/22 17:58
- 更新日時：2018/10/01 11:53
- カテゴリー：設計ツール , FPGA
【Lattice：FPGA】有償IPコアを実機評価したいがどのようにすれば良いか

開発ツールLattice DiamondのIPexpressまたはClarity DesignerのIP Serverタブで評価したい有償IPコアを選択してダウンロードおよびインストールしてください。インストールされましたら、IPexpressまたはClarity Designerのリスト... 詳細表示
- No：954
- 公開日時：2018/08/22 18:01
- 更新日時：2018/09/27 15:46
- カテゴリー： FPGA , 設計ツール
【Lattice：FPGA/設計ツール】Synplify Proのエラーおよびワーニングメッセージの調べ方を知りたい

お手数ですが、Synplify Proを単体起動して再度論理合成を実行してください。ログのエラーやワーニングの番号をクリックするとヘルプが開き、意味を調べることができます。詳細表示
- No：958
- 公開日時：2018/08/22 17:43
- 更新日時：2018/10/01 11:57
- カテゴリー：設計ツール , FPGA
【Lattice：FPGA/設計ツール】Diamond Programmerで使用するSPIフラッシュがリストにない

Diamond Programmerでは新しいSPIフラッシュメモリを追加することができます。リストにあるSPIフラッシュメモリから、使用するSPIフラッシュメモリに近い仕様のものを選択し、データシートを参照しながら各種パラメータを設定して保存してください。またSPI SE... 詳細表示
- No：1637
- 公開日時：2018/08/22 17:44
- 更新日時：2020/07/17 14:58
- カテゴリー： FPGA , 設計ツール
【Lattice：FPGA/設計ツール】Lattice DiamondのActive-HDLの制限事項を知りたい

HDLコードの行数、およびインスタンス数に制限があります。ラティスセミコンダクターのシミュレーションライブラリを含むコードでは、3万行および2千個のインスタンスまで、シミュレーションライブラリを含まないコードでは5千行および500個のインスタンスまで、となっています。詳細表示
- No：957
- 公開日時：2018/08/22 18:01
- 更新日時：2018/10/01 11:58
- カテゴリー：設計ツール , FPGA

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