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- No：9771
- 公開日時：2022/01/26 17:57
- 更新日時：2024/04/16 16:24
- カテゴリー：当サイトについて , CPLD , FPGA , 電源管理IC , 設計ツール , その他 , その他 , Auto MCU and Processor , Analog , Power Management , RF , Wi-Fi/BT , Digital Networking , i.MX , Kinetis , LPC , NFC , 開発ツール , i.MX RT , Security , MCX
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- No：320
- 公開日時：2018/07/26 19:30
- 更新日時：2024/04/16 16:28
- カテゴリー：当サイトについて , プロセッサ , 電源IC , データ・コンバータ , マイコン , ロジック , その他 , クロック/タイミング , センサ , RFとマイクロ波 , アンプ , オーディオ , スイッチ/マルチプレクサ , インターフェイス , モーター・ドライバ , ワイヤレス・コネクティビティ , アイソレーション , CPLD , FPGA , 電源管理IC , 設計ツール , その他 , Sensors , Memories , USB , Clocks&Timing solutions , Wireless Connectivity , DLP , DLP Pico Display , DLP Light Control , DLP 開発サポート , MOSFET , IGBT , HEMT(GaN) , ゲートドライバーIC , モーターコントロールIC , 産業用絶縁型インターフェース , リニア電圧レギュレータ , DC-DCコンバータ , マイクロコントローラ , その他
【Lattice：CPLD】 Mach4000ZE CPLDファミリデバイス情報のまとめ

注意:ispMach4000ZEは旧世代製品のため採用をご検討の際は必ず販売代理店までお問い合わせください。・Mach4000ZECPLDファミリ紹介資料デバイスの特徴、プロダクトテーブルのまとめです。採用のご検討にあたっては本資料をご参照ください。 ... 詳細表示
- No：8808
- 公開日時：2021/07/12 17:01
- 更新日時：2021/11/02 18:02
- カテゴリー： CPLD
【Lattice：CPLD】 Mach4000V CPLDファミリデバイス情報のまとめ

注意:ispMach4000Vは旧世代製品のため採用をご検討の際は必ず販売代理店までお問い合わせください。・Mach4000V CPLDファミリ紹介資料デバイスの特徴、プロダクトテーブルのまとめです。採用のご検討にあたっては本資料をご参照ください。 ... 詳細表示
- No：7841
- 公開日時：2021/07/12 17:01
- 更新日時：2021/11/02 18:03
- カテゴリー： CPLD
【Lattice：設計ツール】配置配線後に「VCCIOとGNDに流せる電流値は"n*8mA"まで」とのワーニングが発生するが、どうすれば良いか？

VCCIOとGNDペアの配置はラティスの各デバイスの製品ページから対象デバイスのピン配置 (Pinout)表のCSVファイルを入手して確認してください。基本的な考え方としてはVCCIOx (xはバンク番号)から次のVCCIOxの間が一つのペアとお考え下さい。この間には1本以上のGNDピンが... 詳細表示
- No：7709
- 公開日時：2021/06/25 16:10
- 更新日時：2021/06/30 18:52
- カテゴリー：設計ツール , CPLD , FPGA
【Lattice：設計ツール】Modelsimで、波形表示のフォーマットを変えたい。

Modelsimのシミュレーション波形上で、信号名を右クリック→Radix→フォーマットを選択します。 2進の他に、10進・16進他が選べます。例)/tp/sin_outを2進数から16進数に変更 /tp/sin_outを16進数に変更後詳細表示
- No：7683
- 公開日時：2021/06/18 17:09
- 更新日時：2021/06/29 16:13
- カテゴリー：設計ツール , CPLD , FPGA
【Lattice 設計ツール】ModelSimとActive-HDLの違いを知りたい。

ModelSim LE(Lattice Edition)とActive-HDL LE(Lattice Edition)の違いは以下の表の通りです。 ModelSim LE (※) Active-HDL LE 性能比較 Active-HDL LEの約7倍 (... 詳細表示
- No：7660
- 公開日時：2021/06/18 17:29
- 更新日時：2023/08/29 15:54
- カテゴリー：設計ツール , CPLD , FPGA
【Lattice FPGA】MSL(Moisture Sensitivity Level)を教えてください。

リフローに関するガイドラインが以下のURLよりダウンロードできますので、こちらも併せてご確認いただけますでしょうか。このドキュメントにMSLの情報も含まれております。 http://www.latticesemi.com/en/Support/AnswerDatabase/1/1/0/~/media/598F5... 詳細表示
- No：1759
- 公開日時：2018/09/14 14:45
- 更新日時：2023/08/31 16:27
- カテゴリー： FPGA , CPLD , 電源管理IC
【Lattice 設計ツール】ispLEVER ClassicでispMACH4000シリーズをフィッティングするとGLB入力が制限を超えているというエラーが発生

ispMACH4000シリーズのGLB(Global Logic Blocks)への入力本数は36本までとなっています。そのI/Oブロックへ配置したロジックに大きな入力本数を持つ信号があるため、制限を超えています。 ispLEVER Classicで”Auto_buffering_for_high_... 詳細表示
- No：1638
- 公開日時：2018/08/22 17:43
- 更新日時：2023/08/29 15:55
- カテゴリー：設計ツール , CPLD
【Lattice FPGA】デバイスのBSDLモデルの入手方法

ラティスセミコンダクターの各デバイスのWebページでDocumentationの項目のDownloadsの中でBSDLModelをクリックすると、各デバイス毎のBSDLモデルがでダウンロードできます。詳細表示
- No：974
- 公開日時：2018/08/22 17:41
- 更新日時：2023/08/31 16:40
- カテゴリー： FPGA , CPLD , 電源管理IC

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