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『 FPGA 』内のFAQ

31件中 1 - 10 件を表示

≪ 1 / 4ページ ≫

【Lattice：CPLD/FPGA/電源管理IC/設計ツール】古い開発ツールのダウンロード方法を知りたい

下記URLで「ドキュメントアーカイブ」の「Downloads」にある「Downloadable Software」をクリックすると、過去のツールの各バージョンが表示され、ダウンロードしたいツールのバージョンをクリックすると、別画面に移動し「Software License Agreement」... 詳細表示
- No：190
- 公開日時：2018/08/17 16:34
- 更新日時：2018/10/01 11:48
- カテゴリー： CPLD , FPGA , 電源管理IC , 設計ツール
【Lattice：CPLD/FPGA/電源管理IC】デバイスのMTBF値(またはFIT数)を知りたい

ラティスセミコンダクターではMTBF値は提供していませんが、信頼性レポートのFIT値から算出(MTBF=1/FIT)してください。 Lattice Products Reliability Report http://www.latticesemi.com/view_document?docu... 詳細表示
- No：209
- 公開日時：2018/08/17 16:33
- 更新日時：2018/10/01 11:46
- カテゴリー： CPLD , FPGA , 電源管理IC
【Lattice：FPGA/設計ツール】Lattice Diamondの有償版と無償版の違い

SubscriptionとFreeの違いはターゲットデバイスのみです。高速シリアルトランシーバ(SerDes)を搭載しているデバイス(例：ECP5-UM、ECP3、ECP2/Mなど）を使用する場合は、SerDes使用の有無に関わらずSubscriptionが必要となります。 SerDesを搭... 詳細表示
- No：963
- 公開日時：2018/08/21 18:13
- 更新日時：2018/10/01 11:55
- カテゴリー： FPGA , 設計ツール
【Lattice：FPGA/設計ツール】Lattice Diamondの回路図エディタで入力・出力ポートを追加する方法

Lattice DiamondのSchematic Editorで入力および出力ポートを追加するには次の手順を行います。１．入力段および出力段のシンボル(ANDゲートやF/Fなど)のピンにワイヤを接続２．ワイヤに名前を付ける３．I/Oポートのアイコンを右クリックし方向(Input/... 詳細表示
- No：966
- 公開日時：2018/08/22 17:58
- 更新日時：2018/10/01 11:53
- カテゴリー： FPGA , 設計ツール
【Lattice：FPGA/設計ツール】Synplify Proのエラーおよびワーニングメッセージの調べ方を知りたい

お手数ですが、Synplify Proを単体起動して再度論理合成を実行してください。ログのエラーやワーニングの番号をクリックするとヘルプが開き、意味を調べることができます。詳細表示
- No：958
- 公開日時：2018/08/22 17:43
- 更新日時：2018/10/01 11:57
- カテゴリー： FPGA , 設計ツール
【Lattice：CPLD/FPGA】デバイスの未使用ピンの処理方法

ラティスセミコンダクターのFPGAおよびCPLDでは、未使用ピンには自動で内部プルダウン処理されるため、外部処理は必要ありません。下記、ラティスセミコンダクターのアンサーデータベースもご参照ください。 Do the unused I/O pins need to be groun... 詳細表示
- No：940
- 公開日時：2018/08/22 17:43
- 更新日時：2018/10/01 11:42
- カテゴリー： CPLD , FPGA
【Lattice：FPGA】MachXO2とMachXO3L/3LFの違いは

MachXO2、MachXO3L、MachXO3LFの主な違いは以下の通りです。回路情報の保存主な相違点 MachXO2 FLASH：10万回書き換え可能 SRAM：書き換え無制限 (SRAMアクセスはJTAG経由のみ) ・幅広いパッケ... 詳細表示
- No：814
- 公開日時：2018/08/17 17:09
- 更新日時：2018/12/11 09:54
- カテゴリー： FPGA
【Lattice：FPGA】MachXO2でLVDS33を使用する方法

Lattice DiamondのSpreadsheet ViewではIO TypeでLVDS25を選択し、制約ファイル*.lpfとして保存してください。次に*.lpfをエディタで開き、そのバンクのVCCIO設定を以下のように3.3Vとして保存してください。例)バンク1のピン"a1"および"... 詳細表示
- No：952
- 公開日時：2018/08/22 18:01
- 更新日時：2018/09/27 15:50
- カテゴリー： FPGA , 設計ツール
【Lattice：FPGA/設計ツール】Lattice DiamondのActive-HDLの制限事項を知りたい

HDLコードの行数、およびインスタンス数に制限があります。ラティスセミコンダクターのシミュレーションライブラリを含むコードでは、3万行および2千個のインスタンスまで、シミュレーションライブラリを含まないコードでは5千行および500個のインスタンスまで、となっています。詳細表示
- No：957
- 公開日時：2018/08/22 18:01
- 更新日時：2018/10/01 11:58
- カテゴリー： FPGA , 設計ツール
【Lattice：CPLD/FPGA/電源管理IC】デバイスの熱抵抗値のデータを知りたい

下記URLのテクニカルノートをご参照ください。 Thermal Management http://www.latticesemi.com/en/Support/AnswerDatabase/6/8/~/media/8089531A8153497C8E370914638998E9.ashx 詳細表示
- No：199
- 公開日時：2018/08/17 15:19
- 更新日時：2018/10/01 11:47
- カテゴリー： CPLD , FPGA , 電源管理IC

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