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『 FPGA 』内のFAQ

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【Lattice：FPGA/設計ツール】Lattice Diamondの起動時に”License check out failed”が発生してしまい起動できない

ほとんどの場合はライセンスファイルの設定ミスかライセンス期限切れが原因ですので、・環境変数がライセンスファイルに正しく設定されているか・ライセンスファイルを開き、期限が切れていないかをご確認いただき、いずれも問題無いようであればライセンスを再発行することで回避できる... 詳細表示
- No：961
- 公開日時：2018/08/22 17:58
- 更新日時：2018/10/01 11:56
- カテゴリー：設計ツール , FPGA
【Lattice：CPLD/FPGA】デバイスの未使用ピンの処理方法

ラティスセミコンダクターのFPGAおよびCPLDでは、未使用ピンには自動で内部プルダウン処理されるため、外部処理は必要ありません。下記、ラティスセミコンダクターのアンサーデータベースもご参照ください。 Do the unused I/O pins need to be groun... 詳細表示
- No：940
- 公開日時：2018/08/22 17:43
- 更新日時：2018/10/01 11:42
- カテゴリー： CPLD , FPGA
【Lattice：CPLD/FPGA/電源管理IC】デバイスのMTBF値(またはFIT数)を知りたい

ラティスセミコンダクターではMTBF値は提供していませんが、信頼性レポートのFIT値から算出(MTBF=1/FIT)してください。 Lattice Products Reliability Report http://www.latticesemi.com/view_document?docu... 詳細表示
- No：209
- 公開日時：2018/08/17 16:33
- 更新日時：2018/10/01 11:46
- カテゴリー： FPGA , CPLD , 電源管理IC
【Lattice：FPGA/設計ツール】Synplify Proのエラーおよびワーニングメッセージの調べ方を知りたい

お手数ですが、Synplify Proを単体起動して再度論理合成を実行してください。ログのエラーやワーニングの番号をクリックするとヘルプが開き、意味を調べることができます。詳細表示
- No：958
- 公開日時：2018/08/22 17:43
- 更新日時：2018/10/01 11:57
- カテゴリー：設計ツール , FPGA
【Lattice：FPGA/設計ツール】Lattice Diamondの回路図エディタで入力・出力ポートを追加する方法

Lattice DiamondのSchematic Editorで入力および出力ポートを追加するには次の手順を行います。１．入力段および出力段のシンボル(ANDゲートやF/Fなど)のピンにワイヤを接続２．ワイヤに名前を付ける３．I/Oポートのアイコンを右クリックし方向(Input/... 詳細表示
- No：966
- 公開日時：2018/08/22 17:58
- 更新日時：2018/10/01 11:53
- カテゴリー：設計ツール , FPGA
【Lattice：FPGA/設計ツール】Lattice Diamondの有償版と無償版の違い

SubscriptionとFreeの違いはターゲットデバイスのみです。高速シリアルトランシーバ(SerDes)を搭載しているデバイス(例：ECP5-UM、ECP3、ECP2/Mなど）を使用する場合は、SerDes使用の有無に関わらずSubscriptionが必要となります。 SerDesを搭... 詳細表示
- No：963
- 公開日時：2018/08/21 18:13
- 更新日時：2018/10/01 11:55
- カテゴリー：設計ツール , FPGA
【Lattice：FPGA】FPGAへのダウンロードに失敗する

次のことをご確認、お試しいただけますでしょうか。１．デバイスへの供給電圧は正常(推奨動作条件内)でしょうか？２．ダウンロードケーブルへの電源供給は正常(緑のLEDが点灯)でしょうか？３．ダウンロードケーブルのリード線や各コネクタは正常に接続しているでしょうか？４．PCのUS... 詳細表示
- No：207
- 公開日時：2018/08/17 16:34
- 更新日時：2018/09/27 15:59
- カテゴリー： FPGA
【Lattice：FPGA】MachXO2とMachXO3L/3LFの違いは

MachXO2、MachXO3L、MachXO3LFの主な違いは以下の通りです。回路情報の保存主な相違点 MachXO2 FLASH：10万回書き換え可能 SRAM：書き換え無制限 (SRAMアクセスはJTAG経由のみ) ・幅広いパッケ... 詳細表示
- No：814
- 公開日時：2018/08/17 17:09
- 更新日時：2018/12/11 09:54
- カテゴリー： FPGA
【Lattice：CPLD/FPGA/電源管理IC】デバイスのRoHS対応

下記にラティスデバイスのRoHS対応に関するレターがあります。 RoHS準拠に関するレター http://www.latticesemi.com/-/media/LatticeSemi/Documents/QualityAssurance/OZ/ROHS-Compliance-Letter... 詳細表示
- No：796
- 公開日時：2018/08/17 15:17
- 更新日時：2018/10/01 11:45
- カテゴリー： FPGA , CPLD , 電源管理IC
【Lattice:FPGA】JTAGピンを専用ピンとして使用する場合、JTAGENBピンはどのように処理すれば良いでしょうか。

JTAGENBピンはOpenとしてください。【注意事項】 Diamond　Spreadsheet ViewのGlobal Preferencesタブで"JTAG_PORT = ENABLE"(デフォルト) となっていることをご確認ください。この場合JTAGENBピンはコンフィグレーション後にユー... 詳細表示
- No：1760
- 公開日時：2018/09/14 14:46
- 更新日時：2018/10/01 11:50
- カテゴリー： FPGA

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