【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.11 GPMC NAND
Index <前の手順へ 2.11 GPMC NAND - NANDのR/B#信号を使用するデザインですか? 通常、NANDからのアクティブhighのレディ、 アクティブLowのビジー (R/B#) 出力はオープンドレインで、 GPMC0_WAIT0 信号... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.1 LPDDR4 Introduction)
Index Index(DDR) <前の手順へ 3 LPDDR4 Board Design and Layout Guidance 3.1 LPDDR4 Introduction LPDDR4は、JEDEC標準JESD209-4、低電力ダ... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.2 LPDDR4 Device Implementations Supported)
Index Index(DDR) <前の手順へ 3.2 LPDDR4 Device Implementations Supported LPDDR4は、さまざまな実装トポロジをサポートしています。 ただし、デバイスはLPDDR4の単一の16ビット... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.3 LPDDR4 Interface Schematics)
Index Index(DDR) <前の手順へ 3.3 LPDDR4 Interface Schematics 上記のように、LPDDR4は多くの異なる実装トポロジをサポートしますが、 デバイスはLPDDR4の単一の16ビットチャネルのみをサポートし... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.4 Compatible JEDEC LPDDR4 Devices)
Index Index(DDR) <前の手順へ 3.4 Compatible JEDEC LPDDR4 Devices Table 3-2に、このインターフェイスと互換性のある JEDECLPDDR4デバイスのパラメータを示します。 ... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.5 Placement)
Index Index(DDR) <前の手順へ 3.5 Placement Figure 3-2に、プロセッサとLPDDR4デバイスに必要な配置を示します。 この図の寸法は、Table 3-3に定義されています。 配置は、 デバイスが取り付けられて... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.6 LPDDR4 Keepout Region)
Index Index(DDR) <前の手順へ 3.6 LPDDR4 Keepout Region LPDDR4回路に使用されるPCBの領域は、他の信号から分離する必要があります。 LPDDR4キープアウト領域はこの目的のために定義されており、 ... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.7 Net Classes)
Index Index(DDR) <前の手順へ 3.7 Net Classes ルーティングルールは、ネットクラスと呼ばれるグループの信号に適用されます。 各ネットクラスには、同じルーティング要件を持つ信号が含まれています。 これにより、これらのル... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.8 LPDDR4 Signal Termination)
Index Index(DDR) <前の手順へ 3.8 LPDDR4 Signal Termination LPDDR4メモリには、データグループネット用にソフトウェアで構成可能な on-dieターミネーションがあります。 DDRサブシステムに... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.9 LPDDR4 VREF Routing)
Index Index(DDR) <前の手順へ 3.9 LPDDR4 VREF Routing LPDDR4メモリは、アドレス/コマンドバスとデータバスに対して、 それぞれ独自のVREFCAとVREFDQを内部で生成します。 同様に、DDR... 詳細表示
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