【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(2.6 DDR4 Keepout Region)
Index Index(DDR) <前の手順へ 2.6 DDR4 Keepout Region DDR4回路に使用されるPCBの領域は、 他の信号から分離されている必要があります。 DDR4禁止領域は、この目的のために定義され、Figure 2-... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(2.8 Net Classes)
Index Index(DDR) <前の手順へ 2.8 Net Classes ルーティングルールは、ネットクラスと呼ばれる グループ内の信号に適用されます。各ネットクラスには、 同じルーティング要件を持つ信号が含まれます。 これにより、こ... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.7 Net Classes)
Index Index(DDR) <前の手順へ 3.7 Net Classes ルーティングルールは、ネットクラスと呼ばれるグループの信号に適用されます。 各ネットクラスには、同じルーティング要件を持つ信号が含まれています。 これにより、これらのルートの... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.9 LPDDR4 VREF Routing)
Index Index(DDR) <前の手順へ 3.9 LPDDR4 VREF Routing LPDDR4メモリは、アドレス/コマンドバスとデータバスに対して、 それぞれ独自のVREFCAとVREFDQを内部で生成します。 同様に、DDR PH... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.10 LPDDR4 VTT)
Index Index(DDR) <前の手順へ 3.10 LPDDR4 VTT DDR3やDDR4とは異なり、LPDDR4構成のアドレス/制御バスの PCBで終端する必要はありません。 すべての終端は内部で処理されます(on-die) した... 詳細表示
【TI: プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(High-Speed Interface Layout Guidelines:1...
Index Index(DDR) Index(HighSpeed) <前の手順へ 1 Introduction 1.1 Scope このアプリケーションレポートは、システム設計者がプラットフォームを 設計する際のベストプラクティスを実装... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.3 LPDDR4 Interface Schematics)
Index Index(DDR) <前の手順へ 3.3 LPDDR4 Interface Schematics 上記のように、LPDDR4は多くの異なる実装トポロジをサポートしますが、 デバイスはLPDDR4の単一の16ビットチャネルのみをサポートします。... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.4 Compatible JEDEC LPDDR4 Devices)
Index Index(DDR) <前の手順へ 3.4 Compatible JEDEC LPDDR4 Devices Table 3-2に、このインターフェイスと互換性のある JEDECLPDDR4デバイスのパラメータを示します。 ... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(3.8 LPDDR4 Signal Termination)
Index Index(DDR) <前の手順へ 3.8 LPDDR4 Signal Termination LPDDR4メモリには、データグループネット用にソフトウェアで構成可能な on-dieターミネーションがあります。 DDRサブシステムには、ア... 詳細表示
【TI:プロセッサ】 AM64x /AM243xの回路図チェック:推奨事項 2.8 DDR(4 Revision History)
Index Index(DDR) <前の手順へ 4 Revision History 注:以前のリビジョンのページ番号は、 現在のバージョンのページ番号と異なる場合があります。 2021年1月1日から2021年7月30日までの変更 (f... 詳細表示
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